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右边的组合逻辑电路的功能是让计时器在00时停止计时

作者:球探体育    来源:网络整理    发布时间:2021-03-12 11:51    浏览量:

74LS191为可预置的四位二进制加/减法计数器,其管脚图如图所示:

74ls191中文资料汇总(74ls191引脚图及成果_逻辑成果及应用电路)

74ls191引脚成果

RCO进位/借位输出端

MAX/MIN进位/借位输出端

CTEN计数节制端

QA-QD计数输出端

U/D计数节制端

CLK时钟输入端

LOAD异步并行置入端(低电平有效)。

74LS191逻辑成果

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74ls191应用电路

1、操作同步二进制可逆计数器74LS191接成同步八进制计数器。

74LS191是16进制同步计数器,要做8进制计时器,就要在输出为8时给输入端置0。于是的8进制计数器真值表。

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由真值表的逻辑函数式:

Y=O’3

于是得设计电路:

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2、试用二进制计数器74LS191接成24秒倒计时器。

设计说明:首先将开关j1置地端,球探体育,这时给组合逻辑电路置入“24”。然后将j1置VCC,电路开始倒计时。计时进程中将j1置地可以暂停计时,j1置VCC后继承计时。当计时竣事后(即为“00”时)遏制计时。若要从头计时,只需从头启动即可。

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右边的组合逻辑电路的成果是让计时器在“00”时遏制计时。

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